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一、项目简述本项目使用苏州硬禾信息科技有限公司设计的小脚丫FPGA开发板设计了一个完成定时、测温、报警、控制的小项目，并通过上位机显示、下发音乐配置数据。本项目B站介绍：https://www.bilibili.com/video/BV1Vh411k7QV/二、研究进展（一）研究内容：l ...
Verilog实现串并转换
项目文件：SIPO.zip//------------------------------------------------------// File Name : SIPO.v// Author &n...
FPGA时序分析和时序约束
时序分析：时序分析的目的就是通过分析FPGA设计中各个寄存器之间的数据和时钟传输路径，来分析数据延迟和时钟延迟之间的关系。一个设计OK的系统，必然能够保证整个系统中所有的寄存器都能够正确的寄存数据。数据和时钟传输路径是由EDA软件，通过针对特定器件布局布线得到的。时序约束：两个作用告知 EDA 软件...
CDC跨时钟域信号处理
保证时序电路的时序要求：建立时间：在有效的时钟沿到来之前，输入端的输入信号需要保持稳定不变的最小时间保持时间：在有效的时钟沿到来之后，输入端的输入信号需要保持稳定不变的最小时间CDC问题1：亚稳态亚稳态原因：亚稳态解决方法：对于单信号来说，使用 Double FF来进行信号同步CDC问题2：数据收敛...
已上传pdf，从开发到验证的完整手册《FPGA之道》狄超 刘萌著 西安交通大学出版社 pdf
发现一本好书！从数模电，到FPGA结构，到原理，到应用。后面是设计方法，验证方法，非常好的一本书。ps：pdf是从网上找的，如果侵权，请联系我删除！仅供学习用途！下载链接：FPGA之道...
